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搜索资源列表

  1. Arbiter

    1下载:
  2. Arbiter.v verilog实现 三路请求,使用循环策略的仲裁器 含有看门狗电路-Arbiter.v Verilog achieve three road request, the use of recycled strategy for containing the arbitration watchdog circuit
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1956
    • 提供者:夏虫
  1. modulewdt

    1下载:
  2. 用verilog语言编写的看门狗模块modulewdt-verilog language with the watchdog module modulewdt
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2008-10-13
    • 文件大小:3140
    • 提供者:谢迪
  1. watchdog.tar

    0下载:
  2. verilog编写的watchdog代码!请参考!
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2311
    • 提供者:刘志刚
  1. watch_dog

    4下载:
  2. 看门狗的verilog源代码,项目的一部分,绝对正确,测试通过。-Watchdog of the Verilog source code, part of the project, is absolutely correct, the test.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2016-11-04
    • 文件大小:1090
    • 提供者:WangYong
  1. watchver

    0下载:
  2. watchdog with verilog
  3. 所属分类:software engineering

    • 发布日期:2017-04-07
    • 文件大小:141270
    • 提供者:Y.D. chang
  1. watch_dog_rtl_source

    0下载:
  2. Watchdog timer verilog RTL code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:10271
    • 提供者:Chris
  1. watchdog

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  2. 看门狗定时器Verilog源码;用于MCU的辅助模块,定时特定的时间来做硬件复位,是用于避免固件跑死的一个机制。-Watchdog verilog source.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:4340
    • 提供者:郑佛少
  1. LIP1701CORE_system_watchdog

    0下载:
  2. System watchdog verilog code
  3. 所属分类:Static control

    • 发布日期:2017-04-04
    • 文件大小:287268
    • 提供者:jc
  1. VMD642_CPLD

    0下载:
  2. 本例程位于 VMD642_CPLD目录中。 使用 CPLD 实现辅助译码、LED 指示灯控制、看门狗等各种逻辑控制电路。源程序使 用 Verilog HDL书写,编译开发系统使用 Cypress公司的 Warp 6.3。-This routine is located VMD642_CPLD directory. Using CPLD implementation auxiliary decoding, LED indicator control, watchdog, and othe
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-05
    • 文件大小:48621
    • 提供者:ye
  1. watchdog

    1下载:
  2. 针对低功耗和低频率的看门狗设计verilog代码-watch dog design code
  3. 所属分类:Driver develop

    • 发布日期:2016-11-04
    • 文件大小:2048
    • 提供者:冰人
  1. watch_dog

    0下载:
  2. 看门狗程序设计,使用verilog HDL语言编写-Watchdog program design, using verilog HDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1094
    • 提供者:甄红欣
  1. watch_dog

    0下载:
  2. 看门狗的verilog源代码,项目的一部分,绝对正确,测试通过。-Watchdog of the Verilog source code, part of the project, is absolutely correct, the test.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-12
    • 文件大小:1135
    • 提供者:equences
  1. DW_apb_wdt

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  2. verilog实现watch dog,可直接用于芯片开发中。-erilog realization watchdog, can be directly used for chip development.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1801151
    • 提供者:刘精轶
  1. dw_apb_wdt_db

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  2. verilog实现watchdog参考文档,可用于实现watchdog。-verilog realize watchdog reference documentation can be used to implement the watchdog.
  3. 所属分类:Communication

    • 发布日期:2017-05-02
    • 文件大小:731838
    • 提供者:刘精轶
  1. multi_cpu

    0下载:
  2. 主要功能包含: // 1.按照CPU小系统规范要求,实现了各寄存器的读、写、控制等功能 // 2.实现了部分CPU读取配置字功能 // 3.实现了看门狗功能 // 4.实现了FLASH和BOOTROM控制功能 // 5.其它用户功能(按需进行添加)(The main functions include: According to the 1. / / CPU small system specifications, the realizatio
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-01
    • 文件大小:6144
    • 提供者:fengyuanzyt
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